中科院半导体所研制成功低功耗高性能Delta-Sigma调制器芯片

中国科学院半导体研究所超晶格国家重点实验室高速图像传感及信息处理课题组研究员刘力源等研制出一款低功耗、高性能Delta-Sigma调制器。相关研究成果以A Discrete-Time Audio Modulator Using Dynamic Amplifier With Speed Enhancement and Flicker Noise Reduction Techniques 为题发表在集成电路芯片设计领域学术期刊IEEE Journal of Solid-State Circuits（JSSC）上。 3aEt>x  
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　　Delta-Sigma调制器构成的模数转换器（ADC）广泛应用于高精度、低功耗物联网节点信号获取和处理场景，是目前模拟数字混合集成电路芯片设计研究领域的重要研究方向之一。在国家重点研发计划、国家科技重大专项和中科院青年创新促进会计划等支持下，课题组提出了一种新型动态放大器实现了开关电容积分器和两种闪烁噪声消除技术有效降低了噪声，研制出一种低功耗高精度离散时间Delta-Sigma调制器。 sP9^IP  
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　　调制器采用运用四位逐次逼近量化器的两阶前馈架构，包括两个基于新型动态放大器的开关电容积分器和一个四比特逐次逼近量化器。积分器采用新型时序控制电路解决了电压跌落问题；采用加速支路在有效的共模电压范围内提高了积分器的差模特性；采用两种闪烁噪声抑制技术，改善了信噪比(SNR)。基于65nm CMOS工艺实现了调制器，测试结果表明，24kHz带宽内信号噪声失真比（SNDR）为89.6 dB，动态范围（DR）为91 dB，功耗仅为49μW @ 0.8 V电源电压。图1(a)和（b）分别为芯片照片和测量的输出信号频谱结果。论文第一作者为直博五年级学生马松。 c=jcvDQ6W  
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　　论文链接：https://ieeexplore.ieee.org/document/8862953 BO8%:/37[4  
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